(12)--3.3 集成运放的典型电路 - 分页.ppt
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1、3.3集成运放的典型电路第三章多级放大电路第三章多级放大电路莆田学院莆田学院 三电教研室模拟电路多媒体课件三电教研室模拟电路多媒体课件3.3集成运放的典型电路典型的集成运放双极型集成运放 F007CMOS 集成运放 C145731、引脚一、双极型集成运放 F0071、引脚一、双极型集成运放 F007(a)123487651、引脚一、双极型集成运放 F007(a)(b)连接示意图12348765F007 的引脚及连接示意图2、电路原理图图 3.4.1F007 电路原理图2、电路原理图图 3.4.1F007 电路原理图输入级2、电路原理图图 3.4.1F007 电路原理图输入级偏置电路2、电路原理
2、图图 3.4.1F007 电路原理图输入级中间级偏置电路2、电路原理图图 3.4.1F007 电路原理图输入级中间级输入级偏置电路1.偏置电路+VCCT8-VCCT9T12T13T10T11R4R5I8I3,4IC9IC10IREFIC13至输入级至中间级图 3.4.1-1F007 的偏置电路1.偏置电路+VCCT8-VCCT9T12T13T10T11R4R5I8I3,4IC9IC10IREFIC13至输入级至中间级基准电流:图 3.4.1-1F007 的偏置电路1.偏置电路+VCCT8-VCCT9T12T13T10T11R4R5I8I3,4IC9IC10IREFIC13至输入级至中间级基准电
3、流:图 3.4.1-1F007 的偏置电路1.偏置电路+VCCT8-VCCT9T12T13T10T11R4R5I8I3,4IC9IC10IREFIC13至输入级至中间级基准电流:u基准电流产生各放大级所需的偏置电流。图 3.4.1-1F007 的偏置电路1.偏置电路+VCCT8-VCCT9T12T13T10T11R4R5I8I3,4IC9IC10IREFIC13至输入级至中间级基准电流:u基准电流产生各放大级所需的偏置电流。各路偏置电流的关系:图 3.4.1-1F007 的偏置电路1.偏置电路+VCCT8-VCCT9T12T13T10T11R4R5I8I3,4IC9IC10IREFIC13至输
4、入级至中间级基准电流:u基准电流产生各放大级所需的偏置电流。各路偏置电流的关系:IREFI11IC10I3,4IC9IC8IC12IC13微电流源镜像电流源输入级镜像电流源中间级输出级图 3.4.1-1F007 的偏置电路2.输入级uO+VCC-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI12.输入级uT1、T2、T3、T4 组成共集-共基差分放大电路;uO+VCC-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI12.输入级uT1、T2、T3、T4 组成共集-共基差
5、分放大电路;uT1、T2 基极接收差分输入信号。uO+VCC-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI12.输入级uT1、T2、T3、T4 组成共集-共基差分放大电路;uT1、T2 基极接收差分输入信号。uT5、T6 有源负载;uO+VCC-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI12.输入级uT1、T2、T3、T4 组成共集-共基差分放大电路;uT1、T2 基极接收差分输入信号。uT5、T6 有源负载;uT4 集电极送出单端输出信号至中间级。uO+VCC
6、-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI12.输入级uT1、T2、T3、T4 组成共集-共基差分放大电路;uT1、T2 基极接收差分输入信号。uT5、T6 有源负载;uT4 集电极送出单端输出信号至中间级。uOuRW 调零电阻,R 外接电阻。+VCC-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI12.输入级uT1、T2、T3、T4 组成共集-共基差分放大电路;uT1、T2 基极接收差分输入信号。uT5、T6 有源负载;uT4 集电极送出单端输出信号至中间级。
7、uOuRW 调零电阻,R 外接电阻。uT7 与R2 组成射极输出器。+VCC-VEET6R1I3,4IC10IC9R2R3RRWT4T2T7T5T3T1T8T9图 3.4.1-2uI2uI1若暂不考虑 T7 和调零电路则电路可简化为:+VCC-VEEI3,4T4T2T3T1I8RCRCuI1uI2uO图 3.4.1.2简化示意图 若暂不考虑 T7 和调零电路则电路可简化为:+VCC-VEEI3,4T4T2T3T1I8RCRCuI1uI2uOuT1、T2 共集组态,具有较高的差模输入电阻和共模输入电压。图 3.4.1.2简化示意图 若暂不考虑 T7 和调零电路则电路可简化为:+VCC-VEEI3
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