(1.7.5)--6.5 边沿触发的触发器电子技术基础.ppt
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电子技术基础6 组合逻辑电路6.5 边沿触发的触发器边沿触发的触发器由于JK触发器存在一次变化问题,所以抗干扰能力差。为了提高触发器工作的可靠性,希望触发器的次态(新态)仅决定于CLK的下降沿(或上升沿)到达时刻的输入信号的状态,与CLK的其它时刻的信号无关。这样出现了各种边沿触发器。用两个D触发器构成的边沿触发器用两个D触发器构成的边沿触发器工作原理010101当CLK0触发器FF2状态不变,FF1输出状态与D相同;当CLK1,即上升沿触发器FF1状态与前沿到来之前的D状态相同并保持(因为CLK10)。而与此同时,FF2输出Q的状态被置成前沿到来之前的D的状态,而与其它时刻D的状态无关。用两个D触发器构成的边沿触发器特性表与符号1X10X0XXX为了实现异步置位和复位功能,则引入了SD和RD置位端和复位端。当 SD1,RD0时,Q1(置位);当 SD0,RD1时,Q0(复位)。正常工作加低电平。边沿触发器动作特点边沿触发器也有JK触发器,如利用传输时间的边沿触发器就是边沿JK触发器,它是在CLK的下降沿动作的。边沿触发器的共同动作特点是触发器的次态仅取决于CP信号的上升沿或下降沿到达时输入的逻辑状态,故有效地提高了触发器的抗干扰能力。下降沿触发的边沿JK触发器边沿触发器的应用R RD DQ QCPCPS SD DD D
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